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ludc
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2021年4月7日
基于Xilinx的RapidIO核的SRIO的自定义AXI总线设计
摘要: Rapid IO协议由于无主机,且各设备之间可以并行交换信息,所以广泛应用于对交换速率要求高,且交互复杂的应用中。 Xilinx现在有支持Serial RapidIO Gen2的核,可以应用在此场景中,但Xilinx 的 Rapid IO 核对外接口仅有 AXI 流接口 ,且对各类数据流的处理需要外
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posted @ 2021-04-07 15:15 ludc
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