08 2023 档案

摘要:# 【FPGA】 DDR3读写(基于User Interface) ## DDR3概述 DDR3 (double data rate 3 synchronous dynamic RAM) 第三代双倍数据速率同步动态随机存储器 - 同步:数据的速去和写入时钟同步 - 动态:数据掉电无法保存,需要周期性 阅读全文
posted @ 2023-08-15 21:59 ALright壹 阅读(1539) 评论(0) 推荐(0)
摘要:# 【FPGA】基于FIFO的串口通信 目标:接收外部串口数据并通过fifo缓存,通过按钮发送缓存的数据 ## Source ### top_module - uart模块 - 按钮按下检测电路 - 此处可以改进增加消抖电路 - fifo读写数据控制 ```verilog `timescale 1n 阅读全文
posted @ 2023-08-12 16:14 ALright壹 阅读(669) 评论(0) 推荐(0)