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摘要： 定义一个示例模组，代码如下： module block_nonblock( Clk, Rst_n, a, b, c, out ); input Clk; input Rst_n; input a,b,c; output reg[1:0]out; //out = a + b + c，out最大为3，所 阅读全文

摘要： 1、设置一个最大值为10的四位计数器，Verilog代码如下： module BCD_Counter( Clk, Cin, Rst_n, Cout, q ); input Clk; //计数器基准时钟 input Cin; //计数器进位输入 input Rst_n; //系统复位 // outpu 阅读全文