摘要:
原图片处理后效果嘿嘿!verilog 很神奇 一起学习verilog 吧!一起探索FPGA 阅读全文
posted @ 2011-06-24 23:05
老凯
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老凯
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摘要:
sobel 算法 几个子模块的RTL view 。compute 算法模块,addr_gen 地址产生器,state_machine 状态机,sobel_slave 从机。除了这几个模块之外还有cpu,仲裁器,memory 行为模块(仿真测试用)。下次把 算法模块具体解释以及代码。 阅读全文
posted @ 2011-06-24 22:49
老凯
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