宋桓公

摘要： 目的：安装 Pillow库 现状是：python是3.4，easy_install没有安装；pip没有安装， 步骤： 1、安装Pillow库需要安装pip 2、安装pip需要安装easy_install（ps：这个不知道是不是必须的，应为按理说easy_install和pip都是 管理包的工具，为啥 阅读全文

摘要： 在《MiZ702学习笔记7——尝试自制带总线IP》，我曾提到了AXI4-Lite的简单用法，驱动了下流水灯，只涉及到了写总线。今天，我想利用之前的VGA模块，将AXI4-Lite的读写都应用上。这篇文章主要是思想的介绍，以及AXI4-Lite读的方法。一些细节请先阅读《MiZ702学习笔记7——尝试... 阅读全文

摘要： 还记得《MiZ702学习笔记（番外篇）——纯PL VGA驱动》这篇文章中，用verilog写了一个VGA驱动。我们今天要介绍的就是将这个工程打包成一个普通的IP，目的是为后面的一篇文章做个铺垫。 打包成一个普通的IP的目的，可以直接将这个IP粘贴到Block文件中。（和用文本实例化是一个意思）。应为我们调用zynq的核的时候一般是用Block的形式，为了zynq和我们的VGA模块更方便的组织起来... 阅读全文

摘要： 说到vivado的仿真确实是很有意思，不管是ISE还是Quartus都可以自己自动生成测试平台的完整构架，但是vivado不行，所有的测试代码自己写！（我反正是查了好久，都没发现vivado如何自动生成测试平台的完整构架）。而且vivado与众不同的地方是，他的测试文件和设计文件的类型是一模一样的。... 阅读全文

摘要： 之前，添加vivado自带IP的时候，都是以图形化的方式：一般是新建一个Block Design顶层文件，然后将图形化的ip贴到，Block Design中。 但是，在进行PL的开发过程中，有时不想使用Block Design的形式，而是想使用文本的形式进行例化。今天就以添加一个时钟管理ip为例，讲一讲如何用于文本的形式，实例化vivado自带IP。 点击导航窗口中Project Manager下... 阅读全文