2022年11月17日
FPGA ——防止信号被优化（转载）
摘要： 转载：https://blog.csdn.net/weixin_46062412/article/details/125299437 Quartus 对这种情况的处理是增加约束，共有2种情况： a， 需要保留的信号类型是 wire 在定义的时候在后面增加/* synthesis keep */。 例 阅读全文
posted @ 2022-11-17 11:09 AdriftCore芯研社 阅读(2749) 评论(0) 推荐(0)