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摘要：
之前的项目和培训中，都只用到了AXI-Lite或者AXI-Stream，对于AXI-FULL知之甚少，主要是每次一看到那么多接口信号就望而却步了。 现在为了调试DDR，痛下决心要把AXI-FULL弄懂。 前面已经介绍了基本的接口信号，本文主要是总结一下使用AXI-FULL调试的过程。 首先想到的是用 阅读全文
posted @ 2016-07-18 21:26
christ0127
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虽然Xilinx已经将和AXI时序有关的细节都封装起来，给出了官方IP和向导生成自定义IP，用户只需要关注自己的逻辑实现，但是还是有必要简单了解一下AXI的时序，毕竟咱是做硬件设计的。 AXI（Advanced eXtensible Interface）是一种总线协议，该协议是ARM公司提出的AMB 阅读全文
posted @ 2016-07-16 17:31
christ0127
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看了一段时间的DDR手册，感觉大体有一点了解了，想要实际上板调试，然而实验室可用的开发板不多，拿了一块zynq板看了看，DDR确实有，但是已经集成了控制器，而且控制器还放到了PS端，PL只能通过AXI接口访问。 无奈另外两块开发板也这样，索性就用AXI去控制吧，正好还能再复习一遍AXI。 先简单介绍 阅读全文
posted @ 2016-07-15 11:44
christ0127
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今天接到一个电话面试，对方问我在一个项目中维护了多少行代码。 我懵逼了，从来没有统计过啊，怎么还会有这种需求？ 当时一脸茫然的想了想，回答了一个，呃...差不多两千多行吧...感觉很心虚 挂完电话之后大概看了一下最近的一个项目，光其中某一个顶层文件就一千多行了好吧，感觉自己回答的好low 但是又不能 阅读全文
posted @ 2016-07-14 17:03
christ0127
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在DDR3详解（以Micron MT41J128M8 1Gb DDR3 SDRAM为例）中已经讲了DDR芯片的管脚及用法，但是实际生活中我们经常看到的都是DIMM（SO-DIMM）的条子，不能直接接触到DDR芯片，那么问题来了，DIMM芯片上的金手指和DDR芯片的引脚之间是怎样联系的呢？ 下面找到了 阅读全文
posted @ 2016-07-11 21:46
christ0127
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Marvel Says New Iron Man Will Be a Black Woman 原文出处：http://abcnews.go.com/Entertainment/marvel-iron-man-black-woman/story?id=40375824 At the end of th 阅读全文
posted @ 2016-07-09 11:04
christ0127
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这两天正在学习FPGA如何控制DDR3的读写，找到一篇个人感觉比较有意义的文章，可以对DDR的内部结构有一个初步的了解。原文出处：http://blog.chinaunix.net/uid-28458801-id-3459509.html，感谢大神的付出。 首先，我们先了解一下内存的大体结构工作流程 阅读全文
posted @ 2016-07-06 11:40
christ0127
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以下内容转自 艾米电子 - 使用有符号数，Verilog（http://www.cnblogs.com/yuphone/archive/2010/12/12/1903647.html） Verilog-1995中的有符号数 在Verilog-1995中，只有integer数据类型被转移成有符号数，而 阅读全文
posted @ 2016-07-01 12:24
christ0127
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作为一个硬件程序设计民工，最近一直在学习python，写个爬虫，排个序，再画个界面，其实还是挺好玩的。然而这不是我的主业啊！！！-_-||| 下学期开学就要找工作了，明天刚好是新的一个月，还是滚回去调我的FPGA吧。 今天先更新一个很小很小的例子作为开端，这是前几天xxx给我出的一道很随意的题目，主 阅读全文
posted @ 2016-06-30 16:00
christ0127
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以下内容参考自鱼C论坛，并进行了修改，原帖【排序技术哪家强，各种排序算法。】http://bbs.fishc.com/thread-56352-1-1.html 1. 选择排序。每次选择最小的一项放到最前面。效率 : 需要的次数是取决于列表的长度。 2. 冒泡排序。每两个数比较，互换。每轮选出最大的 阅读全文
posted @ 2016-06-30 12:31
christ0127
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