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2017年4月14日
基于UVM的verilog验证
摘要: 基于UVM的verilog验证 Abstract 本文介绍UVM框架,并以crc7为例进行UVM的验证,最后指出常见的UVM验证开发有哪些坑,以及怎么避免。 Introduction 本例使用环境:ModelSim 10.2c,UVM-1.1d,Quartus II 13.1(64 bit),器件库
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posted @ 2017-04-14 10:52 yf869778412
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