我的随笔

基于UVM的verilog验证

yf869778412 2017-04-14 10:52 阅读:1902 评论:0 推荐:0

verilog 条件编译命令`ifdef、`else、`endif 的应用

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FPGA Prototyping By Verilog Examples第五章状态机FSM设计

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Synplify9.6.2破解（转帖）

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yf869778412 2017-03-25 11:24 阅读:460 评论:0 推荐:1