2017年3月17日
D触发器及计数器的VHDL设计
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posted @ 2017-03-17 21:09 bgd140206114 阅读(1) 评论(0) 推荐(0)
采用DDS(数字频率合成法)设计信号发生器，完成设计方案。
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posted @ 2017-03-17 12:26 bgd140206114 阅读(6) 评论(1) 推荐(0)