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2017年7月31日
VerilogHDL常用的仿真知识
摘要: 在描述完电路之后,我们需要进行对代码进行验证,主要是进行功能验证。现在验证大多是基于UVM平台写的systemverilog,然而我并不会sv,不过我会使用verilog进行简单的验证,其实也就是所谓的仿真。这里就来记录一下一些验证的基础吧。 一、验证基础与仿真原理 ①综合中的语法,都适用于仿真,在
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posted @ 2017-07-31 13:20 IC_learner
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