SDRAM学习笔记(一) sdram_init
摘要:仿真结果 1 module sdram_init 2 ( 3 input sys_clk , //100Mhz 4 input sys_rst_n , 5 6 output reg [3:0] init_cmd , //init_cmd {cs# , ras# , cas# , we# } 7 ou
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2021-06-19 17:23
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24LC64_IIC_verilog控制读写
摘要:PS:EEPROM单次写时间比较长,24LC64要5ms,才能进行读操作,否则不会响应地址,示波器观察的。 1‘给出单次写仿真图1;(sda上面的蓝色是主从三态门切换时候,未知态,实测波形,也会有小尖峰出现) 2’给出单次读仿真图2; 3‘给出main代码;(用quartus的issp观察数据的)
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2021-06-12 18:53
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