摘要：本练习的目的是研究锁存器、触发器和寄存器。Part I RS锁存器Altera的FPGA含有可供用户使用的触发器电路。在Part IV演示如何使用它。这里探讨如何不使用专用触发器来创建存储单元。图1描述了门控锁存器电路。可用门级电路或表达式来描述。part1.v //rs锁存器门级描述 1 //part 1:rs_ff 2 module rs_ff(q,r,s,clk); 3 input clk,r,s; 4 output q; 5 6 wire r_g,s_g,qa,qb/*synthesis keep*/; 7 8 and(r_g,r,clk); 9 and(s_g,s,clk... 阅读全文

摘要：本节练习主要用组合逻辑电路实现2进制到10进制数字的转换以及BCD码的加法。Part I 2进制数字的显示在HEX3到HEX0上显示SW15-0的值。SW15-12，SW11-8，SW7-4，SW3-0分别对应于HEX3，HEX2，HEX1，HEX0.在数码管上显示0-9，忽略开关表示的数值1010-1111.本练习的目的是手工推导数码管显示的逻辑，要求只用赋值语句和布尔表达式实现。ｐａｒｔ１.ｖpart1顶层文件Code highlighting produced by Actipro CodeHighlighter (freeware)http://www.CodeHighlighter. 阅读全文

摘要：本指南讲述Altera的Quartus　ＩＩ软件如何处理基于Verilog硬件描述语言的设计里时序问题。讨论多种时序参数并解释如何指定时序约束。 目录 1 电路范例 2 时序分析报告 3 指定时序约束 4 时序仿真 Quartus　ＩＩ软件包含一个时序分析模块用来执行对在ＦＰＧＡ芯片里编译实现的电路的所有时序延迟的详细分析。本指南讨论执行的分析的种类和演示如何指定特殊的计时要求。讨论的前提是... 阅读全文

摘要：本指南介绍Altera Monitor Progarm，它可以用来编译、集合、下载和调试Altera’s Nios II processor的程序。本指南将一步一步的描述Altera Monitor Program的特性。 下载和调试Nios II应用程序要求有具备Nios II处理器的FPGA器件。因此，本文假设用户有安装Quartus II（9.0或更高版本）和Nios II EDS软件的计算... 阅读全文

摘要：这篇向导介绍altera的sopc builder软件，它用来实现在altera的FPGA器件上使用Nios II处理器的系统。通过配合Quartus II使用sopc builder实现一个简单的系统来一步一步的详细描述系统的开发流程。 在设计的最后一步包含在一个实际的FPGA器件上配置设计电路，并运行一个应用程序。前提是，一台安装quartus II和Nios II软件的电脑，并连接DE2开发... 阅读全文

摘要：Abstract 将电路分成不同的层次和模块分别进行设计，然后组合，实现电路功能。 Instruction 数字钟的功能： 准确计时，以数字显示时、分、秒； 具有分、时校时功能； 整点报时； 闹钟； 指定： ///////////////////////////////////////////////////////////////////// 管脚 // 端口-------------... 阅读全文