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Vivado PLL IP核的使用

耐心的小黑 2020-10-22 19:14 阅读:1327 评论:0 推荐:0

verilog 实现8位有符号加法器

耐心的小黑 2020-10-03 22:29 阅读:1316 评论:0 推荐:0

Xilinx伪双口RAM实现同步FIFO（解决读写冲突）

耐心的小黑 2021-06-06 23:05 阅读:1281 评论:0 推荐:0

虚拟时钟（Virtual Clock）

耐心的小黑 2021-03-13 19:51 阅读:1273 评论:0 推荐:0

AHB协议的verilog实现（无等待/单次传输）

耐心的小黑 2021-05-03 20:48 阅读:1253 评论:0 推荐:0