摘要：
https://mp.weixin.qq.com/s/5J74euYsxkjlS1QSWU6_Ow 简单介绍BaseTile的实现。 1. Keys 定义了一组配置的Key： 其中： a. SharedMemoryTLEdge：从实现上看，是系统总线的第一条连接边： b. TileKey：用于定义T 阅读全文
posted @ 2020-07-09 21:17
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摘要：
https://mp.weixin.qq.com/s/THo5Mw0099ummLsbXjLutw 简单介绍RocketSubsystem的实现。 1. Params 定义Rocket tile相关的master port/slave port/crossing参数： 2. Keys 定义Rocke 阅读全文
posted @ 2020-06-20 13:59
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https://mp.weixin.qq.com/s/8W2CSwMqjJxZ-jCy2uR0Vg 简单介绍HasTiles的实现。 1. ClockedTileInputs 包含时钟输入的tile inputs： tile inputs指如下两个输入输入端口： clocked则是指： 2. Has 阅读全文
posted @ 2020-06-20 13:57
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摘要：
https://mp.weixin.qq.com/s/pJXXSBvj2hQSICGlNvuUwQ 简单介绍Ports的实现。 1. Port Params 定义外部端口的大小和宽度参数： 其中： a. MasterPortParams：作为主端口的参数； b. SlavePortParams：作为 阅读全文
posted @ 2020-06-20 13:55
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摘要：
https://mp.weixin.qq.com/s/RIW_YxjsrGtU07xtUDEYpA 简单介绍BaseSubsystem的实现。 1. 各种Key 定义了高层次模块使用配置Key： 其中： a. SystemBusKey：用于定义系统总线参数； b. FrontBusKey：用于定义前 阅读全文
posted @ 2020-06-20 13:53
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摘要：
https://mp.weixin.qq.com/s/03mqAmLiaA1JwOePR5IDyQ 简单介绍Configs的实现。 1. BaseSubsystemConfig BaseSubsystemConfig包含基本子系统的配置定义。 1) 核心参数 a. PgLevels：页表层次： b. 阅读全文
posted @ 2020-06-16 10:56
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摘要：
https://mp.weixin.qq.com/s/SiVDERb0ufx3wkASl4ayFw 简单介绍HasRTCModuleImp的实现。 1. outer outer是一个抽象成员： 这是一篇付费文章，请移步付费阅读全文，谢谢！文章链接：https://mp.weixin.qq.com/s 阅读全文
posted @ 2020-06-16 10:52
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https://mp.weixin.qq.com/s/MkKnV42Lh9-yg53D3hg8XQ 简单介绍PeripheryBus的实现。 1. BusAtomics BusAtomics用于定义原子操作相关的参数： 其中： a. arithmetic：表示是否支持数学运算原子操作； b. buf 阅读全文
posted @ 2020-06-15 20:46
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https://mp.weixin.qq.com/s/cTuVq9xnj1Rcb7hrANDmcg 简单介绍MemoryBus的实现。 1. CacheBlockBytes 用于定义和查找参数配置的key： 对应的参数为缓存块的大小(字节数)。 2. BroadcastParams Broadcas 阅读全文
posted @ 2020-06-08 21:02
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https://mp.weixin.qq.com/s/M02OQk4u1yf27CnW7CvGjg 简单介绍InterruptBus的实现。 1. InterruptBusWrapper InterruptBusWrapper用于搜集内部和外部设备中断，然后注入PLIC： 1) int_bus in 阅读全文
posted @ 2020-06-08 21:01
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