【原创】关于$test$plusargs和$value$plusargs的小结【SystemVerilog/Verilog】
    
  nanoty 2015-03-21 10:43
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    【原创】关于generate用法的总结【Verilog】
    
  nanoty 2012-11-13 22:39
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    关于Verilog中的几种赋值语句
    
  nanoty 2012-10-21 21:46
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    【原创】关于include用法的总结【Verilog】
    
  nanoty 2012-11-16 19:55
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    关于Modelsim仿真时不能编译`include文件解决办法【Verilog】【Modelsim】
    
  nanoty 2012-10-29 22:06
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 浙公网安备 33010602011771号
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