05 2018 档案
摘要:目前,在FPGA上嵌入ARM硬核的包括Xilinx的zynq系列以及Intel 的CYCLONEV系列。 Zynq出来有一定市场,但是这个市场不是传统FPGA的主流市场,而是为了和微处理抢一些控制领域的市场。但是目前在反响上,听说,不如预期,首先对小公司来说,同时熟悉ARM和FPGA的人不多,在大公
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摘要:时序约束的一点总结。 打拍。掌握好时序。 手动分配位置,这个不是一定有效。 打破层级或者物理综合,或者自动加流水等综合优化参数调整。 根据实际情况使用异步时钟策略。 换速度更快的片子。 打拍。掌握好时序。 手动分配位置,这个不是一定有效。 打破层级或者物理综合,或者自动加流水等综合优化参数调整。 根
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摘要:尽量用硬核,比如硬件乘法器,这个应该都知道。 结构上的pipeline,简言之就是“拆",最极端的情形是拆到源和目的Reg间只有基本的组合逻辑门,比如说~a & b之类...;当然FPGA里实际不必这样,打个比方,两个xbit的数据做比较,若芯片内是4输入LUT,若有pipeline的必要,那么流水
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摘要:学习FPGA的过程中,要想踏上一步台阶,需要注意一下几点: 时序约束的原因和使用方法,能熟练正确的应用最基本的时钟周期约束,时序例外约束,异步时钟域约束,同步复位的约束,高扇出约束。 清楚FPGA芯片内部时钟资源分布,能够知道自己的逻辑和约束能否让编译器用比较优化的走线布局布线。 清楚内部嵌入式硬核
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摘要:Verilog HDL作为现在最流行的FPGA开发语言,当然是入门基础。 从最简单的代码学起。找最简单的基础实例(带仿真例程),看不懂查阅工具书。看完之后用综合工具综合,然后看RTL图,能看到这些代码最终翻译成了什么样的数字电路。 紧接着就是仿真或者上板实测:用仿真的信号输入到编写的模块里面,才能清
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摘要:逻辑写多了,有时候一些基本的错误忘了避免了。 昨天设计逻辑的时候就不小心触雷了,有个信号有激励没响应,后来看了时序报告,有这么一句话。 这是 什么呢?锁存器啊! 最容易产生的是在always(*)语句中,最后一定是所有分支条件都要描述并赋值。 状态机中,同样如此,不但需要有default的状态,每个
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摘要:独热码在状态机里面使用比价广泛,这一块有些人爱用,有些人嫌烦,有时候可以用用格雷码跳转,不过格雷码只支持那种一步到底的,中间有分支就不好做了,所以后来还是回到了独热码的正道上。 说白了独热码的使用,在对状态判断时,会减少一级组合逻辑,关键路径上少一步,乍看没多少,用多了积累多了,还是一个很客观的数据
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摘要:通俗讲讲什么是FPGA。 FPGA出现之前,所有集成电路都可以看成雕塑家,但是雕成一个成品,往往要浪费很多半成品和原料,这就是ASIC的制造。 后来FPGA出现了,FPGA就是块橡皮泥,什么硬件电路都能模仿,万用IC,想捏成什么样随你,捏的不行,可以重新再捏。这就是为什么被称为可编程。 也可以把FP
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摘要:对于高速的定义,至少要100Msps以上的,这种高速采集多用在军工、航天、天文领域,通信现在用的也越来越多了(比如华为5G相关的项目,已经用到了3Gsps的ADC)。 当然有一些视频相关的领域也会用到高速采集。 对于采集这块的入门,说实话挺难的,因为成本实在是太高,通常高速的ADC价格都在千刀($美
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摘要:FPGA与DSP比较 两者的优势不一样。在硬件层面,DSP是ASIC,如同CPU GPU一样,适宜于量产降低成本,缺点是(硬件)设计一旦确定,便不易于修改。 而FPGA较灵活,可以通过硬件描述语言进行快速设计和改进,但成本较高,传统上讲用于ASIC的prototype设计。 另外,在软件层面上,给D
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摘要:做FPGA主要是要有电路的思想,作为初学者,往往对器件可能不是熟悉,那么应该要对数字电路的知识熟悉。 FPGA中是由触发器和查找表以及互联线等基本结构组成的,其实在逻辑代码里面能够看到的就是与非门以及触发器。 不要把verilog和c语言等同起来,根本就是不同的东西,没有什么可比性,在写一句程序的时
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摘要:最近做电力方面的项目,由于跨行业,所以很长一段时间都在做前期准备工作。 项目设计前应尽量做到面面俱到,否则会在项目设计中遇到下面大概率问题: 性能不满足需求,然后为了提升性能,资源又成了瓶颈; 功能设计频繁变更; 各个模块之间的耦合性问题,导致系统大了之后,时序无法及时收敛。然后就是不断的复工,不断
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摘要:菇凉提问: 做FPGA开发多年,每次菇凉问我,什么是FPGA,我,我,我,不知道如何说起,难以回答。 FPGA是一种器件。其英文名 feild programable gate array 。 通俗来说,是一种功能强大似乎无所不能的器件。通常用于通信、网络、图像处理、工业控制等不同领域的器件。 一直
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摘要:优势一: 更大的并行度。这个主要是通过并发和流水两种技术实现。 A:并发是指重复分配计算资源,使得多个模块之间可以同时独立进行计算。这一点与现在的多核和SIMD技术相似。但相对与SIMD技术,FPGA的并发可以在不同逻辑功能之间进行,而不局限于同时执行相同的功能。举个简单例子说就是使用SIMD 可以
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摘要:在学习FPGA的过程中,注意是在学习过程中,联系FPGA的使用技巧,强烈建议尝试设计一个SDRAM控制器,不要使用IP核。 学习SDRAM控制器设计,能让你掌握很多知识。 更好的使用状态机去精准控制时序。 学会高速设计中必要的技能,也就是时序约束方法,timing report的阅读方法,查找时序问
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