摘要：
VIVADO约束 1、物理约束：I/O 2、时序约束： VIVADO在做时序分析时，默认的条件: 1、VIVADO默认所有的时钟都是有关系的，都是同步的，都做时序分析 2、如果有异步时钟，需要进行异步时钟约束 时钟类型:见https://www.cnblogs.com/yjxmike/p/18739 阅读全文
posted @ 2025-02-26 21:53
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摘要：
同步时钟 定义： 时钟同源（即相位相同或者相位差固定）且频率比为整数倍的两个时钟为同步时钟。 分类： 1、同频同相：此类时钟间数据传输只要满足正常的建立时间和保持时间即可，不需要特殊的同步设计。 2、同频不同相（固定相位差）：此类时钟可以理解为同源时钟下两个时钟因路径不同而导致的偏移，只要控制两个时 阅读全文
posted @ 2025-02-26 20:32
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摘要：
异步复位 当rst_async_n有效时，第一个D触发器的输出是低电平，第二个D触发器的输出rst_sync_n也是低电平，方框2中的异步复位端口有效，输出被复位。 同步释放 假设rst_async_n撤除时发生在clk上升沿，如果不加此电路则可能发生亚稳态事件。加上此电路以后，假设第一级D触发器c 阅读全文
posted @ 2025-02-26 11:12
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摘要：
外部输入数据流通过 输入数据流选择单元 流入到 数据缓存模块，比较常用的存储单元有双口RAM，FIFO，SDRAM等。 第一个缓冲周期：数据流通过“输入数据流选择单元”将数据写入到“数据缓冲模块1”。写完之后进入第二个缓冲周期。 第二个缓冲周期：数据流通过“输入数据流选择单元”将数据写入到“数据缓冲 阅读全文
posted @ 2025-02-26 11:09
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