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摘要: 前言 System generator 安装之后会在Simulin模块库中添加一些Xilinx FPGA专用的模块库,包括Basic Element,Communication,Control Logic,DataTypes,DSP,Math,Memory,Shared Momory,Tool等模块 阅读全文
posted @ 2017-08-09 17:03 LeeLIn。 阅读(3146) 评论(0) 推荐(1) 编辑
摘要: 作者:桂。 时间:2017-08-07 06:47:31 链接:http://www.cnblogs.com/xingshansi/p/7297482.html 前言 Chipscope在FPGA调试中被用来观察内部信号,程序里加入Chipscope相当于有了数字示波器。 本文主要记录Chipsco 阅读全文
posted @ 2017-08-08 17:04 LeeLIn。 阅读(3686) 评论(0) 推荐(0) 编辑
摘要: 作者:桂。 时间:2017-08-05 14:41:36 链接:http://www.cnblogs.com/xingshansi/p/7290224.html 前言 最近的工作内容涉及硬件,三个高频词汇:总线、接口、协议,例如I2C、PCIe、RS-232C、RapidIO(SRIO)以及Auro 阅读全文
posted @ 2017-08-05 23:32 LeeLIn。 阅读(1809) 评论(1) 推荐(2) 编辑
摘要: 前言 多相滤波器解决的是:多速率问题。 通过降采样、插值来改变信号的输出速率(主要利用Nyquist采样定理,保证不混叠),从而降低数据率,多相滤波器为这类操作提供了实现框架。在满足采样定理的前提下,内插/抽取并配合滤波器使用(防止混叠),可以改变数据的速率。 多相滤波的结构也多用在信道化中(即构建 阅读全文
posted @ 2017-08-01 07:52 LeeLIn。 阅读(8941) 评论(3) 推荐(3) 编辑
摘要: 转自:http://www.cnblogs.com/ninghechuan/p/6172237.html 1、notepad++与vivado关联 打开vivado软件,选择菜单栏“Tools——>Options…”,在弹出的对话框中,选择General选项卡,如图1所示。 拉动右边的滚动条到Tex 阅读全文
posted @ 2017-07-16 07:44 LeeLIn。 阅读(8991) 评论(0) 推荐(0) 编辑
摘要: 前言 记录自己用到的模块,随时补充。 主要分类: 一、常用模块 1-FIFO FIFO分为两种,一是输入输出时钟相同(Common clock)的 fifo ;二是输入输出时钟不相同(Independent clocks) FIFO常用于:跨时钟域操作和数据位宽转换。例如:两个独立的时钟域,独立的数 阅读全文
posted @ 2017-07-15 23:32 LeeLIn。 阅读(1285) 评论(0) 推荐(0) 编辑
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posted @ 2017-07-15 07:02 LeeLIn。 阅读(33) 评论(0) 推荐(0) 编辑
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posted @ 2017-07-14 23:07 LeeLIn。 阅读(21) 评论(0) 推荐(0) 编辑
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posted @ 2017-07-14 22:56 LeeLIn。 阅读(5) 评论(0) 推荐(0) 编辑
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posted @ 2017-07-14 22:49 LeeLIn。 阅读(1) 评论(0) 推荐(0) 编辑
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